崗位名稱：FPGA開發(fā)驗(yàn)證工程師（2人）
用工方式：勞務(wù)派遣
投遞郵箱：yhu@cnic.cn
崗位職責(zé)：
1、負(fù)責(zé)FPGA模塊開發(fā)，參與項(xiàng)目需求分析，協(xié)助進(jìn)行核心模塊的詳細(xì)設(shè)計(jì)，并完成代碼開發(fā)；
2、協(xié)助核心模塊RTL設(shè)計(jì)驗(yàn)證，完成FPGA系統(tǒng)仿真和板級調(diào)試及系統(tǒng)調(diào)試，撰寫相關(guān)文檔；
3、分析并解決開發(fā)、調(diào)試過程中遇到的問題。
任職要求：
1、本科及以上學(xué)歷，電子、微電子、通信、計(jì)算機(jī)科學(xué)等相關(guān)專業(yè)背景；
2、熟悉Altera/Xilinx/Lattice等公司芯片開發(fā)環(huán)境及仿真調(diào)試工具；
3、熟悉Verilog HDL語言和時(shí)序約束、時(shí)序分析、時(shí)序優(yōu)化方法；
用工方式：項(xiàng)目聘用
投遞郵箱：yhu@cnic.cn
崗位職責(zé)：
1、負(fù)責(zé)FPGA系統(tǒng)設(shè)計(jì)、關(guān)鍵技術(shù)研究，參與項(xiàng)目需求分析，研究落實(shí)項(xiàng)目技術(shù)細(xì)節(jié)，牽頭核心模塊的詳細(xì)設(shè)計(jì)；
2、獨(dú)立負(fù)責(zé)較復(fù)雜FPGA單元架構(gòu)設(shè)計(jì)和RTL設(shè)計(jì)驗(yàn)證，完成FPGA系統(tǒng)仿真和板級調(diào)試及系統(tǒng)調(diào)試，撰寫FPGA架構(gòu)及單元模塊設(shè)計(jì)和驗(yàn)證文檔；
3、分析并解決開發(fā)、調(diào)試過程中遇到的問題。
任職要求：
1、碩士及以上學(xué)歷，電子、微電子、通信、計(jì)算機(jī)科學(xué)等相關(guān)專業(yè)背景；
2、3年及以上FPGA/ASIC開發(fā)經(jīng)驗(yàn)；
3、熟悉Altera/Xilinx/Lattice等公司芯片開發(fā)環(huán)境及仿真調(diào)試工具；
4、精通Verilog HDL語言和時(shí)序約束、時(shí)序分析、時(shí)序優(yōu)化方法；
5、具有良好的表達(dá)溝通能力和文檔書寫能力、良好協(xié)作意識和團(tuán)隊(duì)合作精神；
用工方式：勞務(wù)派遣
投遞郵箱：yhu@cnic.cn
崗位職責(zé)：
1、負(fù)責(zé)FPGA模塊開發(fā)，參與項(xiàng)目需求分析，協(xié)助進(jìn)行核心模塊的詳細(xì)設(shè)計(jì)，并完成代碼開發(fā)；
2、協(xié)助核心模塊RTL設(shè)計(jì)驗(yàn)證，完成FPGA系統(tǒng)仿真和板級調(diào)試及系統(tǒng)調(diào)試，撰寫相關(guān)文檔；
3、分析并解決開發(fā)、調(diào)試過程中遇到的問題。
任職要求：
1、本科及以上學(xué)歷，電子、微電子、通信、計(jì)算機(jī)科學(xué)等相關(guān)專業(yè)背景；
2、熟悉Altera/Xilinx/Lattice等公司芯片開發(fā)環(huán)境及仿真調(diào)試工具；
3、熟悉Verilog HDL語言和時(shí)序約束、時(shí)序分析、時(shí)序優(yōu)化方法；
4、具有良好的表達(dá)溝通能力和文檔書寫能力、良好協(xié)作意識和團(tuán)隊(duì)合作精神。
崗位名稱：FPGA研發(fā)工程師（1人）
用工方式：項(xiàng)目聘用
投遞郵箱：yhu@cnic.cn
崗位職責(zé)：
1、負(fù)責(zé)FPGA系統(tǒng)設(shè)計(jì)、關(guān)鍵技術(shù)研究，參與項(xiàng)目需求分析，研究落實(shí)項(xiàng)目技術(shù)細(xì)節(jié)，牽頭核心模塊的詳細(xì)設(shè)計(jì)；
2、獨(dú)立負(fù)責(zé)較復(fù)雜FPGA單元架構(gòu)設(shè)計(jì)和RTL設(shè)計(jì)驗(yàn)證，完成FPGA系統(tǒng)仿真和板級調(diào)試及系統(tǒng)調(diào)試，撰寫FPGA架構(gòu)及單元模塊設(shè)計(jì)和驗(yàn)證文檔；
3、分析并解決開發(fā)、調(diào)試過程中遇到的問題。
任職要求：
1、碩士及以上學(xué)歷，電子、微電子、通信、計(jì)算機(jī)科學(xué)等相關(guān)專業(yè)背景；
2、3年及以上FPGA/ASIC開發(fā)經(jīng)驗(yàn)；
3、熟悉Altera/Xilinx/Lattice等公司芯片開發(fā)環(huán)境及仿真調(diào)試工具；
4、精通Verilog HDL語言和時(shí)序約束、時(shí)序分析、時(shí)序優(yōu)化方法；
5、具有良好的表達(dá)溝通能力和文檔書寫能力、良好協(xié)作意識和團(tuán)隊(duì)合作精神；
6、具備網(wǎng)絡(luò)芯片架構(gòu)設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先，有國產(chǎn)FPGA開發(fā)經(jīng)驗(yàn)者優(yōu)先。
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